fpga: x400: Add 1x64, 2x64, and 1x128 DRAM interconnect
Original-commit: daf1ed2ad2fbb72f16a9909fa75a0ba9e2879583
This commit is contained in:
Wade Fife
+634
-325
@@ -18,7 +18,7 @@
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// ENABLE_DRAM : Set to 1 to include the DRAM IP. Set to 0 to exclude it and
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// save resources.
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// AXI_DWIDTH : Data width of AXI interface to the DRAM. Can be 64 or 128.
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// NUM_PORTS : Number of AXI ports to support. Can be 0, 2, or 4.
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||||
// NUM_PORTS : Number of AXI ports to support. Can be 0, 1, 2, or 4.
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//
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@@ -140,6 +140,9 @@ module x4xx_dram #(
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if (!(
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(NUM_PORTS == 0 ) ||
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(NUM_PORTS == 1 && AXI_DWIDTH == 64) ||
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(NUM_PORTS == 1 && AXI_DWIDTH == 128) ||
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(NUM_PORTS == 2 && AXI_DWIDTH == 64) ||
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||||
(NUM_PORTS == 2 && AXI_DWIDTH == 128) ||
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||||
(NUM_PORTS == 4 && AXI_DWIDTH == 64) ||
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||||
(NUM_PORTS == 4 && AXI_DWIDTH == 128)
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@@ -213,331 +216,637 @@ module x4xx_dram #(
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wire dram0_axi_rvalid;
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if (AXI_DWIDTH == 64) begin : gen_axi_64
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||||
axi_inter_4x64_512_bd axi_inter_4x64_512_bd_i (
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.M0_AXI_ACLK (dram0_ui_clk ),
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.M0_AXI_ARESETN (~dram0_ui_clk_sync_rst ),
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.M0_AXI_araddr (dram0_axi_araddr ),
|
||||
.M0_AXI_arburst (dram0_axi_arburst ),
|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
.S0_AXI_araddr (dram_axi_araddr [ 2*0 +: 32]),
|
||||
.S0_AXI_arburst (dram_axi_arburst [ 2*0 +: 2]),
|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
.S0_AXI_arlen (dram_axi_arlen [ 8*0 +: 8]),
|
||||
.S0_AXI_arlock (dram_axi_arlock [ 1*0 +: 1]),
|
||||
.S0_AXI_arprot (dram_axi_arprot [ 3*0 +: 3]),
|
||||
.S0_AXI_arqos (dram_axi_arqos [ 4*0 +: 4]),
|
||||
.S0_AXI_arready (dram_axi_arready [ 1*0 +: 1]),
|
||||
.S0_AXI_arregion(dram_axi_arregion[ 4*0 +: 4]),
|
||||
.S0_AXI_arsize (dram_axi_arsize [ 3*0 +: 3]),
|
||||
.S0_AXI_arvalid (dram_axi_arvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 2*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
.S0_AXI_awprot (dram_axi_awprot [ 3*0 +: 3]),
|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
.S0_AXI_awregion(dram_axi_awregion[ 4*0 +: 4]),
|
||||
.S0_AXI_awsize (dram_axi_awsize [ 3*0 +: 3]),
|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
.S0_AXI_bresp (dram_axi_bresp [ 2*0 +: 2]),
|
||||
.S0_AXI_bvalid (dram_axi_bvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_rid (dram_axi_rid [ 1*0 +: 1]),
|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1]),
|
||||
.S1_AXI_araddr (dram_axi_araddr [ 32*1 +: 32]),
|
||||
.S1_AXI_arburst (dram_axi_arburst [ 2*1 +: 2]),
|
||||
.S1_AXI_arcache (dram_axi_arcache [ 4*1 +: 4]),
|
||||
.S1_AXI_arid (dram_axi_arid [ 1*1 +: 1]),
|
||||
.S1_AXI_arlen (dram_axi_arlen [ 8*1 +: 8]),
|
||||
.S1_AXI_arlock (dram_axi_arlock [ 1*1 +: 1]),
|
||||
.S1_AXI_arprot (dram_axi_arprot [ 3*1 +: 3]),
|
||||
.S1_AXI_arqos (dram_axi_arqos [ 4*1 +: 4]),
|
||||
.S1_AXI_arready (dram_axi_arready [ 1*1 +: 1]),
|
||||
.S1_AXI_arregion(dram_axi_arregion[ 4*1 +: 4]),
|
||||
.S1_AXI_arsize (dram_axi_arsize [ 3*1 +: 3]),
|
||||
.S1_AXI_arvalid (dram_axi_arvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_awaddr (dram_axi_awaddr [ 32*1 +: 32]),
|
||||
.S1_AXI_awburst (dram_axi_awburst [ 2*1 +: 2]),
|
||||
.S1_AXI_awcache (dram_axi_awcache [ 4*1 +: 4]),
|
||||
.S1_AXI_awid (dram_axi_awid [ 1*1 +: 1]),
|
||||
.S1_AXI_awlen (dram_axi_awlen [ 8*1 +: 8]),
|
||||
.S1_AXI_awlock (dram_axi_awlock [ 1*1 +: 1]),
|
||||
.S1_AXI_awprot (dram_axi_awprot [ 3*1 +: 3]),
|
||||
.S1_AXI_awqos (dram_axi_awqos [ 4*1 +: 4]),
|
||||
.S1_AXI_awready (dram_axi_awready [ 1*1 +: 1]),
|
||||
.S1_AXI_awregion(dram_axi_awregion[ 4*1 +: 4]),
|
||||
.S1_AXI_awsize (dram_axi_awsize [ 3*1 +: 3]),
|
||||
.S1_AXI_awvalid (dram_axi_awvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_bid (dram_axi_bid [ 1*1 +: 1]),
|
||||
.S1_AXI_bready (dram_axi_bready [ 1*1 +: 1]),
|
||||
.S1_AXI_bresp (dram_axi_bresp [ 2*1 +: 2]),
|
||||
.S1_AXI_bvalid (dram_axi_bvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_rid (dram_axi_rid [ 1*1 +: 1]),
|
||||
.S1_AXI_rlast (dram_axi_rlast [ 1*1 +: 1]),
|
||||
.S1_AXI_rready (dram_axi_rready [ 1*1 +: 1]),
|
||||
.S1_AXI_rresp (dram_axi_rresp [ 2*1 +: 2]),
|
||||
.S1_AXI_rvalid (dram_axi_rvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_wlast (dram_axi_wlast [ 1*1 +: 1]),
|
||||
.S1_AXI_wready (dram_axi_wready [ 1*1 +: 1]),
|
||||
.S1_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*1 +: AXI_DWIDTH/8]),
|
||||
.S1_AXI_wvalid (dram_axi_wvalid [ 1*1 +: 1]),
|
||||
.S2_AXI_araddr (dram_axi_araddr [ 32*2 +: 32]),
|
||||
.S2_AXI_arburst (dram_axi_arburst [ 2*2 +: 2]),
|
||||
.S2_AXI_arcache (dram_axi_arcache [ 4*2 +: 4]),
|
||||
.S2_AXI_arid (dram_axi_arid [ 1*2 +: 1]),
|
||||
.S2_AXI_arlen (dram_axi_arlen [ 8*2 +: 8]),
|
||||
.S2_AXI_arlock (dram_axi_arlock [ 1*2 +: 1]),
|
||||
.S2_AXI_arprot (dram_axi_arprot [ 3*2 +: 3]),
|
||||
.S2_AXI_arqos (dram_axi_arqos [ 4*2 +: 4]),
|
||||
.S2_AXI_arready (dram_axi_arready [ 1*2 +: 1]),
|
||||
.S2_AXI_arregion(dram_axi_arregion[ 4*2 +: 4]),
|
||||
.S2_AXI_arsize (dram_axi_arsize [ 3*2 +: 3]),
|
||||
.S2_AXI_arvalid (dram_axi_arvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_awaddr (dram_axi_awaddr [ 32*2 +: 32]),
|
||||
.S2_AXI_awburst (dram_axi_awburst [ 2*2 +: 2]),
|
||||
.S2_AXI_awcache (dram_axi_awcache [ 4*2 +: 4]),
|
||||
.S2_AXI_awid (dram_axi_awid [ 1*2 +: 1]),
|
||||
.S2_AXI_awlen (dram_axi_awlen [ 8*2 +: 8]),
|
||||
.S2_AXI_awlock (dram_axi_awlock [ 1*2 +: 1]),
|
||||
.S2_AXI_awprot (dram_axi_awprot [ 3*2 +: 3]),
|
||||
.S2_AXI_awqos (dram_axi_awqos [ 4*2 +: 4]),
|
||||
.S2_AXI_awready (dram_axi_awready [ 1*2 +: 1]),
|
||||
.S2_AXI_awregion(dram_axi_awregion[ 4*2 +: 4]),
|
||||
.S2_AXI_awsize (dram_axi_awsize [ 3*2 +: 3]),
|
||||
.S2_AXI_awvalid (dram_axi_awvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_bid (dram_axi_bid [ 1*2 +: 1]),
|
||||
.S2_AXI_bready (dram_axi_bready [ 1*2 +: 1]),
|
||||
.S2_AXI_bresp (dram_axi_bresp [ 2*2 +: 2]),
|
||||
.S2_AXI_bvalid (dram_axi_bvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*2 +: AXI_DWIDTH]),
|
||||
.S2_AXI_rid (dram_axi_rid [ 1*2 +: 1]),
|
||||
.S2_AXI_rlast (dram_axi_rlast [ 1*2 +: 1]),
|
||||
.S2_AXI_rready (dram_axi_rready [ 1*2 +: 1]),
|
||||
.S2_AXI_rresp (dram_axi_rresp [ 2*2 +: 2]),
|
||||
.S2_AXI_rvalid (dram_axi_rvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*2 +: AXI_DWIDTH]),
|
||||
.S2_AXI_wlast (dram_axi_wlast [ 1*2 +: 1]),
|
||||
.S2_AXI_wready (dram_axi_wready [ 1*2 +: 1]),
|
||||
.S2_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*2 +: AXI_DWIDTH/8]),
|
||||
.S2_AXI_wvalid (dram_axi_wvalid [ 1*2 +: 1]),
|
||||
.S3_AXI_araddr (dram_axi_araddr [ 32*3 +: 32]),
|
||||
.S3_AXI_arburst (dram_axi_arburst [ 2*3 +: 2]),
|
||||
.S3_AXI_arcache (dram_axi_arcache [ 4*3 +: 4]),
|
||||
.S3_AXI_arid (dram_axi_arid [ 1*3 +: 1]),
|
||||
.S3_AXI_arlen (dram_axi_arlen [ 8*3 +: 8]),
|
||||
.S3_AXI_arlock (dram_axi_arlock [ 1*3 +: 1]),
|
||||
.S3_AXI_arprot (dram_axi_arprot [ 3*3 +: 3]),
|
||||
.S3_AXI_arqos (dram_axi_arqos [ 4*3 +: 4]),
|
||||
.S3_AXI_arready (dram_axi_arready [ 1*3 +: 1]),
|
||||
.S3_AXI_arregion(dram_axi_arregion[ 4*3 +: 4]),
|
||||
.S3_AXI_arsize (dram_axi_arsize [ 3*3 +: 3]),
|
||||
.S3_AXI_arvalid (dram_axi_arvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_awaddr (dram_axi_awaddr [ 32*3 +: 32]),
|
||||
.S3_AXI_awburst (dram_axi_awburst [ 2*3 +: 2]),
|
||||
.S3_AXI_awcache (dram_axi_awcache [ 4*3 +: 4]),
|
||||
.S3_AXI_awid (dram_axi_awid [ 1*3 +: 1]),
|
||||
.S3_AXI_awlen (dram_axi_awlen [ 8*3 +: 8]),
|
||||
.S3_AXI_awlock (dram_axi_awlock [ 1*3 +: 1]),
|
||||
.S3_AXI_awprot (dram_axi_awprot [ 3*3 +: 3]),
|
||||
.S3_AXI_awqos (dram_axi_awqos [ 4*3 +: 4]),
|
||||
.S3_AXI_awready (dram_axi_awready [ 1*3 +: 1]),
|
||||
.S3_AXI_awregion(dram_axi_awregion[ 4*3 +: 4]),
|
||||
.S3_AXI_awsize (dram_axi_awsize [ 3*3 +: 3]),
|
||||
.S3_AXI_awvalid (dram_axi_awvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_bid (dram_axi_bid [ 1*3 +: 1]),
|
||||
.S3_AXI_bready (dram_axi_bready [ 1*3 +: 1]),
|
||||
.S3_AXI_bresp (dram_axi_bresp [ 2*3 +: 2]),
|
||||
.S3_AXI_bvalid (dram_axi_bvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*3 +: AXI_DWIDTH]),
|
||||
.S3_AXI_rid (dram_axi_rid [ 1*3 +: 1]),
|
||||
.S3_AXI_rlast (dram_axi_rlast [ 1*3 +: 1]),
|
||||
.S3_AXI_rready (dram_axi_rready [ 1*3 +: 1]),
|
||||
.S3_AXI_rresp (dram_axi_rresp [ 2*3 +: 2]),
|
||||
.S3_AXI_rvalid (dram_axi_rvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*3 +: AXI_DWIDTH]),
|
||||
.S3_AXI_wlast (dram_axi_wlast [ 1*3 +: 1]),
|
||||
.S3_AXI_wready (dram_axi_wready [ 1*3 +: 1]),
|
||||
.S3_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*3 +: AXI_DWIDTH/8]),
|
||||
.S3_AXI_wvalid (dram_axi_wvalid [ 1*3 +: 1])
|
||||
);
|
||||
if (NUM_PORTS == 1) begin : gen_axi_1x64
|
||||
assign dram0_axi_arid = 4'b0;
|
||||
assign dram0_axi_awid = 4'b0;
|
||||
assign dram0_axi_bid = 4'b0;
|
||||
assign dram0_axi_rid = 4'b0;
|
||||
axi_inter_1x64_512_bd axi_inter_1x64_512_bd_i (
|
||||
.M0_AXI_ACLK (dram0_ui_clk ),
|
||||
.M0_AXI_ARESETN (~dram0_ui_clk_sync_rst ),
|
||||
.M0_AXI_araddr (dram0_axi_araddr ),
|
||||
.M0_AXI_arburst (dram0_axi_arburst ),
|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
//.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
//.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
//.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
//.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
.S0_AXI_araddr (dram_axi_araddr [ 32*0 +: 32]),
|
||||
.S0_AXI_arburst (dram_axi_arburst [ 2*0 +: 2]),
|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
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|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 32*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
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|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
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|
||||
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|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
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|
||||
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|
||||
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|
||||
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|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1])
|
||||
);
|
||||
end else if (NUM_PORTS == 2) begin : gen_axi_2x64
|
||||
axi_inter_2x64_512_bd axi_inter_2x64_512_bd_i (
|
||||
.M0_AXI_ACLK (dram0_ui_clk ),
|
||||
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|
||||
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|
||||
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|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
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|
||||
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|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
.S0_AXI_arlen (dram_axi_arlen [ 8*0 +: 8]),
|
||||
.S0_AXI_arlock (dram_axi_arlock [ 1*0 +: 1]),
|
||||
.S0_AXI_arprot (dram_axi_arprot [ 3*0 +: 3]),
|
||||
.S0_AXI_arqos (dram_axi_arqos [ 4*0 +: 4]),
|
||||
.S0_AXI_arready (dram_axi_arready [ 1*0 +: 1]),
|
||||
.S0_AXI_arregion(dram_axi_arregion[ 4*0 +: 4]),
|
||||
.S0_AXI_arsize (dram_axi_arsize [ 3*0 +: 3]),
|
||||
.S0_AXI_arvalid (dram_axi_arvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 32*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
.S0_AXI_awprot (dram_axi_awprot [ 3*0 +: 3]),
|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
.S0_AXI_awregion(dram_axi_awregion[ 4*0 +: 4]),
|
||||
.S0_AXI_awsize (dram_axi_awsize [ 3*0 +: 3]),
|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
.S0_AXI_bresp (dram_axi_bresp [ 2*0 +: 2]),
|
||||
.S0_AXI_bvalid (dram_axi_bvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_rid (dram_axi_rid [ 1*0 +: 1]),
|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1]),
|
||||
.S1_AXI_araddr (dram_axi_araddr [ 32*1 +: 32]),
|
||||
.S1_AXI_arburst (dram_axi_arburst [ 2*1 +: 2]),
|
||||
.S1_AXI_arcache (dram_axi_arcache [ 4*1 +: 4]),
|
||||
.S1_AXI_arid (dram_axi_arid [ 1*1 +: 1]),
|
||||
.S1_AXI_arlen (dram_axi_arlen [ 8*1 +: 8]),
|
||||
.S1_AXI_arlock (dram_axi_arlock [ 1*1 +: 1]),
|
||||
.S1_AXI_arprot (dram_axi_arprot [ 3*1 +: 3]),
|
||||
.S1_AXI_arqos (dram_axi_arqos [ 4*1 +: 4]),
|
||||
.S1_AXI_arready (dram_axi_arready [ 1*1 +: 1]),
|
||||
.S1_AXI_arregion(dram_axi_arregion[ 4*1 +: 4]),
|
||||
.S1_AXI_arsize (dram_axi_arsize [ 3*1 +: 3]),
|
||||
.S1_AXI_arvalid (dram_axi_arvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_awaddr (dram_axi_awaddr [ 32*1 +: 32]),
|
||||
.S1_AXI_awburst (dram_axi_awburst [ 2*1 +: 2]),
|
||||
.S1_AXI_awcache (dram_axi_awcache [ 4*1 +: 4]),
|
||||
.S1_AXI_awid (dram_axi_awid [ 1*1 +: 1]),
|
||||
.S1_AXI_awlen (dram_axi_awlen [ 8*1 +: 8]),
|
||||
.S1_AXI_awlock (dram_axi_awlock [ 1*1 +: 1]),
|
||||
.S1_AXI_awprot (dram_axi_awprot [ 3*1 +: 3]),
|
||||
.S1_AXI_awqos (dram_axi_awqos [ 4*1 +: 4]),
|
||||
.S1_AXI_awready (dram_axi_awready [ 1*1 +: 1]),
|
||||
.S1_AXI_awregion(dram_axi_awregion[ 4*1 +: 4]),
|
||||
.S1_AXI_awsize (dram_axi_awsize [ 3*1 +: 3]),
|
||||
.S1_AXI_awvalid (dram_axi_awvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_bid (dram_axi_bid [ 1*1 +: 1]),
|
||||
.S1_AXI_bready (dram_axi_bready [ 1*1 +: 1]),
|
||||
.S1_AXI_bresp (dram_axi_bresp [ 2*1 +: 2]),
|
||||
.S1_AXI_bvalid (dram_axi_bvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_rid (dram_axi_rid [ 1*1 +: 1]),
|
||||
.S1_AXI_rlast (dram_axi_rlast [ 1*1 +: 1]),
|
||||
.S1_AXI_rready (dram_axi_rready [ 1*1 +: 1]),
|
||||
.S1_AXI_rresp (dram_axi_rresp [ 2*1 +: 2]),
|
||||
.S1_AXI_rvalid (dram_axi_rvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_wlast (dram_axi_wlast [ 1*1 +: 1]),
|
||||
.S1_AXI_wready (dram_axi_wready [ 1*1 +: 1]),
|
||||
.S1_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*1 +: AXI_DWIDTH/8]),
|
||||
.S1_AXI_wvalid (dram_axi_wvalid [ 1*1 +: 1])
|
||||
);
|
||||
end else if (NUM_PORTS == 4) begin : gen_axi_4x64
|
||||
axi_inter_4x64_512_bd axi_inter_4x64_512_bd_i (
|
||||
.M0_AXI_ACLK (dram0_ui_clk ),
|
||||
.M0_AXI_ARESETN (~dram0_ui_clk_sync_rst ),
|
||||
.M0_AXI_araddr (dram0_axi_araddr ),
|
||||
.M0_AXI_arburst (dram0_axi_arburst ),
|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
.S0_AXI_araddr (dram_axi_araddr [ 32*0 +: 32]),
|
||||
.S0_AXI_arburst (dram_axi_arburst [ 2*0 +: 2]),
|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
.S0_AXI_arlen (dram_axi_arlen [ 8*0 +: 8]),
|
||||
.S0_AXI_arlock (dram_axi_arlock [ 1*0 +: 1]),
|
||||
.S0_AXI_arprot (dram_axi_arprot [ 3*0 +: 3]),
|
||||
.S0_AXI_arqos (dram_axi_arqos [ 4*0 +: 4]),
|
||||
.S0_AXI_arready (dram_axi_arready [ 1*0 +: 1]),
|
||||
.S0_AXI_arregion(dram_axi_arregion[ 4*0 +: 4]),
|
||||
.S0_AXI_arsize (dram_axi_arsize [ 3*0 +: 3]),
|
||||
.S0_AXI_arvalid (dram_axi_arvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 32*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
.S0_AXI_awprot (dram_axi_awprot [ 3*0 +: 3]),
|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
.S0_AXI_awregion(dram_axi_awregion[ 4*0 +: 4]),
|
||||
.S0_AXI_awsize (dram_axi_awsize [ 3*0 +: 3]),
|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
.S0_AXI_bresp (dram_axi_bresp [ 2*0 +: 2]),
|
||||
.S0_AXI_bvalid (dram_axi_bvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_rid (dram_axi_rid [ 1*0 +: 1]),
|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1]),
|
||||
.S1_AXI_araddr (dram_axi_araddr [ 32*1 +: 32]),
|
||||
.S1_AXI_arburst (dram_axi_arburst [ 2*1 +: 2]),
|
||||
.S1_AXI_arcache (dram_axi_arcache [ 4*1 +: 4]),
|
||||
.S1_AXI_arid (dram_axi_arid [ 1*1 +: 1]),
|
||||
.S1_AXI_arlen (dram_axi_arlen [ 8*1 +: 8]),
|
||||
.S1_AXI_arlock (dram_axi_arlock [ 1*1 +: 1]),
|
||||
.S1_AXI_arprot (dram_axi_arprot [ 3*1 +: 3]),
|
||||
.S1_AXI_arqos (dram_axi_arqos [ 4*1 +: 4]),
|
||||
.S1_AXI_arready (dram_axi_arready [ 1*1 +: 1]),
|
||||
.S1_AXI_arregion(dram_axi_arregion[ 4*1 +: 4]),
|
||||
.S1_AXI_arsize (dram_axi_arsize [ 3*1 +: 3]),
|
||||
.S1_AXI_arvalid (dram_axi_arvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_awaddr (dram_axi_awaddr [ 32*1 +: 32]),
|
||||
.S1_AXI_awburst (dram_axi_awburst [ 2*1 +: 2]),
|
||||
.S1_AXI_awcache (dram_axi_awcache [ 4*1 +: 4]),
|
||||
.S1_AXI_awid (dram_axi_awid [ 1*1 +: 1]),
|
||||
.S1_AXI_awlen (dram_axi_awlen [ 8*1 +: 8]),
|
||||
.S1_AXI_awlock (dram_axi_awlock [ 1*1 +: 1]),
|
||||
.S1_AXI_awprot (dram_axi_awprot [ 3*1 +: 3]),
|
||||
.S1_AXI_awqos (dram_axi_awqos [ 4*1 +: 4]),
|
||||
.S1_AXI_awready (dram_axi_awready [ 1*1 +: 1]),
|
||||
.S1_AXI_awregion(dram_axi_awregion[ 4*1 +: 4]),
|
||||
.S1_AXI_awsize (dram_axi_awsize [ 3*1 +: 3]),
|
||||
.S1_AXI_awvalid (dram_axi_awvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_bid (dram_axi_bid [ 1*1 +: 1]),
|
||||
.S1_AXI_bready (dram_axi_bready [ 1*1 +: 1]),
|
||||
.S1_AXI_bresp (dram_axi_bresp [ 2*1 +: 2]),
|
||||
.S1_AXI_bvalid (dram_axi_bvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_rid (dram_axi_rid [ 1*1 +: 1]),
|
||||
.S1_AXI_rlast (dram_axi_rlast [ 1*1 +: 1]),
|
||||
.S1_AXI_rready (dram_axi_rready [ 1*1 +: 1]),
|
||||
.S1_AXI_rresp (dram_axi_rresp [ 2*1 +: 2]),
|
||||
.S1_AXI_rvalid (dram_axi_rvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_wlast (dram_axi_wlast [ 1*1 +: 1]),
|
||||
.S1_AXI_wready (dram_axi_wready [ 1*1 +: 1]),
|
||||
.S1_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*1 +: AXI_DWIDTH/8]),
|
||||
.S1_AXI_wvalid (dram_axi_wvalid [ 1*1 +: 1]),
|
||||
.S2_AXI_araddr (dram_axi_araddr [ 32*2 +: 32]),
|
||||
.S2_AXI_arburst (dram_axi_arburst [ 2*2 +: 2]),
|
||||
.S2_AXI_arcache (dram_axi_arcache [ 4*2 +: 4]),
|
||||
.S2_AXI_arid (dram_axi_arid [ 1*2 +: 1]),
|
||||
.S2_AXI_arlen (dram_axi_arlen [ 8*2 +: 8]),
|
||||
.S2_AXI_arlock (dram_axi_arlock [ 1*2 +: 1]),
|
||||
.S2_AXI_arprot (dram_axi_arprot [ 3*2 +: 3]),
|
||||
.S2_AXI_arqos (dram_axi_arqos [ 4*2 +: 4]),
|
||||
.S2_AXI_arready (dram_axi_arready [ 1*2 +: 1]),
|
||||
.S2_AXI_arregion(dram_axi_arregion[ 4*2 +: 4]),
|
||||
.S2_AXI_arsize (dram_axi_arsize [ 3*2 +: 3]),
|
||||
.S2_AXI_arvalid (dram_axi_arvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_awaddr (dram_axi_awaddr [ 32*2 +: 32]),
|
||||
.S2_AXI_awburst (dram_axi_awburst [ 2*2 +: 2]),
|
||||
.S2_AXI_awcache (dram_axi_awcache [ 4*2 +: 4]),
|
||||
.S2_AXI_awid (dram_axi_awid [ 1*2 +: 1]),
|
||||
.S2_AXI_awlen (dram_axi_awlen [ 8*2 +: 8]),
|
||||
.S2_AXI_awlock (dram_axi_awlock [ 1*2 +: 1]),
|
||||
.S2_AXI_awprot (dram_axi_awprot [ 3*2 +: 3]),
|
||||
.S2_AXI_awqos (dram_axi_awqos [ 4*2 +: 4]),
|
||||
.S2_AXI_awready (dram_axi_awready [ 1*2 +: 1]),
|
||||
.S2_AXI_awregion(dram_axi_awregion[ 4*2 +: 4]),
|
||||
.S2_AXI_awsize (dram_axi_awsize [ 3*2 +: 3]),
|
||||
.S2_AXI_awvalid (dram_axi_awvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_bid (dram_axi_bid [ 1*2 +: 1]),
|
||||
.S2_AXI_bready (dram_axi_bready [ 1*2 +: 1]),
|
||||
.S2_AXI_bresp (dram_axi_bresp [ 2*2 +: 2]),
|
||||
.S2_AXI_bvalid (dram_axi_bvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*2 +: AXI_DWIDTH]),
|
||||
.S2_AXI_rid (dram_axi_rid [ 1*2 +: 1]),
|
||||
.S2_AXI_rlast (dram_axi_rlast [ 1*2 +: 1]),
|
||||
.S2_AXI_rready (dram_axi_rready [ 1*2 +: 1]),
|
||||
.S2_AXI_rresp (dram_axi_rresp [ 2*2 +: 2]),
|
||||
.S2_AXI_rvalid (dram_axi_rvalid [ 1*2 +: 1]),
|
||||
.S2_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*2 +: AXI_DWIDTH]),
|
||||
.S2_AXI_wlast (dram_axi_wlast [ 1*2 +: 1]),
|
||||
.S2_AXI_wready (dram_axi_wready [ 1*2 +: 1]),
|
||||
.S2_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*2 +: AXI_DWIDTH/8]),
|
||||
.S2_AXI_wvalid (dram_axi_wvalid [ 1*2 +: 1]),
|
||||
.S3_AXI_araddr (dram_axi_araddr [ 32*3 +: 32]),
|
||||
.S3_AXI_arburst (dram_axi_arburst [ 2*3 +: 2]),
|
||||
.S3_AXI_arcache (dram_axi_arcache [ 4*3 +: 4]),
|
||||
.S3_AXI_arid (dram_axi_arid [ 1*3 +: 1]),
|
||||
.S3_AXI_arlen (dram_axi_arlen [ 8*3 +: 8]),
|
||||
.S3_AXI_arlock (dram_axi_arlock [ 1*3 +: 1]),
|
||||
.S3_AXI_arprot (dram_axi_arprot [ 3*3 +: 3]),
|
||||
.S3_AXI_arqos (dram_axi_arqos [ 4*3 +: 4]),
|
||||
.S3_AXI_arready (dram_axi_arready [ 1*3 +: 1]),
|
||||
.S3_AXI_arregion(dram_axi_arregion[ 4*3 +: 4]),
|
||||
.S3_AXI_arsize (dram_axi_arsize [ 3*3 +: 3]),
|
||||
.S3_AXI_arvalid (dram_axi_arvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_awaddr (dram_axi_awaddr [ 32*3 +: 32]),
|
||||
.S3_AXI_awburst (dram_axi_awburst [ 2*3 +: 2]),
|
||||
.S3_AXI_awcache (dram_axi_awcache [ 4*3 +: 4]),
|
||||
.S3_AXI_awid (dram_axi_awid [ 1*3 +: 1]),
|
||||
.S3_AXI_awlen (dram_axi_awlen [ 8*3 +: 8]),
|
||||
.S3_AXI_awlock (dram_axi_awlock [ 1*3 +: 1]),
|
||||
.S3_AXI_awprot (dram_axi_awprot [ 3*3 +: 3]),
|
||||
.S3_AXI_awqos (dram_axi_awqos [ 4*3 +: 4]),
|
||||
.S3_AXI_awready (dram_axi_awready [ 1*3 +: 1]),
|
||||
.S3_AXI_awregion(dram_axi_awregion[ 4*3 +: 4]),
|
||||
.S3_AXI_awsize (dram_axi_awsize [ 3*3 +: 3]),
|
||||
.S3_AXI_awvalid (dram_axi_awvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_bid (dram_axi_bid [ 1*3 +: 1]),
|
||||
.S3_AXI_bready (dram_axi_bready [ 1*3 +: 1]),
|
||||
.S3_AXI_bresp (dram_axi_bresp [ 2*3 +: 2]),
|
||||
.S3_AXI_bvalid (dram_axi_bvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*3 +: AXI_DWIDTH]),
|
||||
.S3_AXI_rid (dram_axi_rid [ 1*3 +: 1]),
|
||||
.S3_AXI_rlast (dram_axi_rlast [ 1*3 +: 1]),
|
||||
.S3_AXI_rready (dram_axi_rready [ 1*3 +: 1]),
|
||||
.S3_AXI_rresp (dram_axi_rresp [ 2*3 +: 2]),
|
||||
.S3_AXI_rvalid (dram_axi_rvalid [ 1*3 +: 1]),
|
||||
.S3_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*3 +: AXI_DWIDTH]),
|
||||
.S3_AXI_wlast (dram_axi_wlast [ 1*3 +: 1]),
|
||||
.S3_AXI_wready (dram_axi_wready [ 1*3 +: 1]),
|
||||
.S3_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*3 +: AXI_DWIDTH/8]),
|
||||
.S3_AXI_wvalid (dram_axi_wvalid [ 1*3 +: 1])
|
||||
);
|
||||
end
|
||||
end else begin : gen_axi_128
|
||||
axi_inter_2x128_512_bd axi_inter_2x128_512_bd_i (
|
||||
.M0_AXI_ACLK (dram0_ui_clk ),
|
||||
.M0_AXI_ARESETN (~dram0_ui_clk_sync_rst ),
|
||||
.M0_AXI_araddr (dram0_axi_araddr ),
|
||||
.M0_AXI_arburst (dram0_axi_arburst ),
|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
.S0_AXI_araddr (dram_axi_araddr [ 32*0 +: 32]),
|
||||
.S0_AXI_arburst (dram_axi_arburst [ 2*0 +: 2]),
|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
.S0_AXI_arlen (dram_axi_arlen [ 8*0 +: 8]),
|
||||
.S0_AXI_arlock (dram_axi_arlock [ 1*0 +: 1]),
|
||||
.S0_AXI_arprot (dram_axi_arprot [ 3*0 +: 3]),
|
||||
.S0_AXI_arqos (dram_axi_arqos [ 4*0 +: 4]),
|
||||
.S0_AXI_arready (dram_axi_arready [ 1*0 +: 1]),
|
||||
.S0_AXI_arregion(dram_axi_arregion[ 4*0 +: 4]),
|
||||
.S0_AXI_arsize (dram_axi_arsize [ 3*0 +: 3]),
|
||||
.S0_AXI_arvalid (dram_axi_arvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 32*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
.S0_AXI_awprot (dram_axi_awprot [ 3*0 +: 3]),
|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
.S0_AXI_awregion(dram_axi_awregion[ 4*0 +: 4]),
|
||||
.S0_AXI_awsize (dram_axi_awsize [ 3*0 +: 3]),
|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
.S0_AXI_bresp (dram_axi_bresp [ 2*0 +: 2]),
|
||||
.S0_AXI_bvalid (dram_axi_bvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_rid (dram_axi_rid [ 1*0 +: 1]),
|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1]),
|
||||
.S1_AXI_araddr (dram_axi_araddr [ 32*1 +: 32]),
|
||||
.S1_AXI_arburst (dram_axi_arburst [ 2*1 +: 2]),
|
||||
.S1_AXI_arcache (dram_axi_arcache [ 4*1 +: 4]),
|
||||
.S1_AXI_arid (dram_axi_arid [ 1*1 +: 1]),
|
||||
.S1_AXI_arlen (dram_axi_arlen [ 8*1 +: 8]),
|
||||
.S1_AXI_arlock (dram_axi_arlock [ 1*1 +: 1]),
|
||||
.S1_AXI_arprot (dram_axi_arprot [ 3*1 +: 3]),
|
||||
.S1_AXI_arqos (dram_axi_arqos [ 4*1 +: 4]),
|
||||
.S1_AXI_arready (dram_axi_arready [ 1*1 +: 1]),
|
||||
.S1_AXI_arregion(dram_axi_arregion[ 4*1 +: 4]),
|
||||
.S1_AXI_arsize (dram_axi_arsize [ 3*1 +: 3]),
|
||||
.S1_AXI_arvalid (dram_axi_arvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_awaddr (dram_axi_awaddr [ 32*1 +: 32]),
|
||||
.S1_AXI_awburst (dram_axi_awburst [ 2*1 +: 2]),
|
||||
.S1_AXI_awcache (dram_axi_awcache [ 4*1 +: 4]),
|
||||
.S1_AXI_awid (dram_axi_awid [ 1*1 +: 1]),
|
||||
.S1_AXI_awlen (dram_axi_awlen [ 8*1 +: 8]),
|
||||
.S1_AXI_awlock (dram_axi_awlock [ 1*1 +: 1]),
|
||||
.S1_AXI_awprot (dram_axi_awprot [ 3*1 +: 3]),
|
||||
.S1_AXI_awqos (dram_axi_awqos [ 4*1 +: 4]),
|
||||
.S1_AXI_awready (dram_axi_awready [ 1*1 +: 1]),
|
||||
.S1_AXI_awregion(dram_axi_awregion[ 4*1 +: 4]),
|
||||
.S1_AXI_awsize (dram_axi_awsize [ 3*1 +: 3]),
|
||||
.S1_AXI_awvalid (dram_axi_awvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_bid (dram_axi_bid [ 1*1 +: 1]),
|
||||
.S1_AXI_bready (dram_axi_bready [ 1*1 +: 1]),
|
||||
.S1_AXI_bresp (dram_axi_bresp [ 2*1 +: 2]),
|
||||
.S1_AXI_bvalid (dram_axi_bvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_rid (dram_axi_rid [ 1*1 +: 1]),
|
||||
.S1_AXI_rlast (dram_axi_rlast [ 1*1 +: 1]),
|
||||
.S1_AXI_rready (dram_axi_rready [ 1*1 +: 1]),
|
||||
.S1_AXI_rresp (dram_axi_rresp [ 2*1 +: 2]),
|
||||
.S1_AXI_rvalid (dram_axi_rvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_wlast (dram_axi_wlast [ 1*1 +: 1]),
|
||||
.S1_AXI_wready (dram_axi_wready [ 1*1 +: 1]),
|
||||
.S1_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*1 +: AXI_DWIDTH/8]),
|
||||
.S1_AXI_wvalid (dram_axi_wvalid [ 1*1 +: 1])
|
||||
);
|
||||
if (NUM_PORTS == 1) begin : gen_1x128
|
||||
assign dram0_axi_arid = 4'b0;
|
||||
assign dram0_axi_awid = 4'b0;
|
||||
assign dram0_axi_bid = 4'b0;
|
||||
assign dram0_axi_rid = 4'b0;
|
||||
axi_inter_1x128_512_bd axi_inter_1x128_512_bd_i (
|
||||
.M0_AXI_ACLK (dram0_ui_clk ),
|
||||
.M0_AXI_ARESETN (~dram0_ui_clk_sync_rst ),
|
||||
.M0_AXI_araddr (dram0_axi_araddr ),
|
||||
.M0_AXI_arburst (dram0_axi_arburst ),
|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
//.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
//.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
//.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
//.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
.S0_AXI_araddr (dram_axi_araddr [ 32*0 +: 32]),
|
||||
.S0_AXI_arburst (dram_axi_arburst [ 2*0 +: 2]),
|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
.S0_AXI_arlen (dram_axi_arlen [ 8*0 +: 8]),
|
||||
.S0_AXI_arlock (dram_axi_arlock [ 1*0 +: 1]),
|
||||
.S0_AXI_arprot (dram_axi_arprot [ 3*0 +: 3]),
|
||||
.S0_AXI_arqos (dram_axi_arqos [ 4*0 +: 4]),
|
||||
.S0_AXI_arready (dram_axi_arready [ 1*0 +: 1]),
|
||||
.S0_AXI_arregion(dram_axi_arregion[ 4*0 +: 4]),
|
||||
.S0_AXI_arsize (dram_axi_arsize [ 3*0 +: 3]),
|
||||
.S0_AXI_arvalid (dram_axi_arvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 32*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
.S0_AXI_awprot (dram_axi_awprot [ 3*0 +: 3]),
|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
.S0_AXI_awregion(dram_axi_awregion[ 4*0 +: 4]),
|
||||
.S0_AXI_awsize (dram_axi_awsize [ 3*0 +: 3]),
|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
.S0_AXI_bresp (dram_axi_bresp [ 2*0 +: 2]),
|
||||
.S0_AXI_bvalid (dram_axi_bvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_rid (dram_axi_rid [ 1*0 +: 1]),
|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1])
|
||||
);
|
||||
end else begin : gen_2x128
|
||||
axi_inter_2x128_512_bd axi_inter_2x128_512_bd_i (
|
||||
.M0_AXI_ACLK (dram0_ui_clk ),
|
||||
.M0_AXI_ARESETN (~dram0_ui_clk_sync_rst ),
|
||||
.M0_AXI_araddr (dram0_axi_araddr ),
|
||||
.M0_AXI_arburst (dram0_axi_arburst ),
|
||||
.M0_AXI_arcache (dram0_axi_arcache ),
|
||||
.M0_AXI_arid (dram0_axi_arid ),
|
||||
.M0_AXI_arlen (dram0_axi_arlen ),
|
||||
.M0_AXI_arlock (dram0_axi_arlock ),
|
||||
.M0_AXI_arprot (dram0_axi_arprot ),
|
||||
.M0_AXI_arqos (dram0_axi_arqos ),
|
||||
.M0_AXI_arready (dram0_axi_arready ),
|
||||
.M0_AXI_arregion( ),
|
||||
.M0_AXI_arsize (dram0_axi_arsize ),
|
||||
.M0_AXI_arvalid (dram0_axi_arvalid ),
|
||||
.M0_AXI_awaddr (dram0_axi_awaddr ),
|
||||
.M0_AXI_awburst (dram0_axi_awburst ),
|
||||
.M0_AXI_awcache (dram0_axi_awcache ),
|
||||
.M0_AXI_awid (dram0_axi_awid ),
|
||||
.M0_AXI_awlen (dram0_axi_awlen ),
|
||||
.M0_AXI_awlock (dram0_axi_awlock ),
|
||||
.M0_AXI_awprot (dram0_axi_awprot ),
|
||||
.M0_AXI_awqos (dram0_axi_awqos ),
|
||||
.M0_AXI_awready (dram0_axi_awready ),
|
||||
.M0_AXI_awregion( ),
|
||||
.M0_AXI_awsize (dram0_axi_awsize ),
|
||||
.M0_AXI_awvalid (dram0_axi_awvalid ),
|
||||
.M0_AXI_bid (dram0_axi_bid ),
|
||||
.M0_AXI_bready (dram0_axi_bready ),
|
||||
.M0_AXI_bresp (dram0_axi_bresp ),
|
||||
.M0_AXI_bvalid (dram0_axi_bvalid ),
|
||||
.M0_AXI_rdata (dram0_axi_rdata ),
|
||||
.M0_AXI_rid (dram0_axi_rid ),
|
||||
.M0_AXI_rlast (dram0_axi_rlast ),
|
||||
.M0_AXI_rready (dram0_axi_rready ),
|
||||
.M0_AXI_rresp (dram0_axi_rresp ),
|
||||
.M0_AXI_rvalid (dram0_axi_rvalid ),
|
||||
.M0_AXI_wdata (dram0_axi_wdata ),
|
||||
.M0_AXI_wlast (dram0_axi_wlast ),
|
||||
.M0_AXI_wready (dram0_axi_wready ),
|
||||
.M0_AXI_wstrb (dram0_axi_wstrb ),
|
||||
.M0_AXI_wvalid (dram0_axi_wvalid ),
|
||||
.S0_AXI_ACLK (dram_clk ),
|
||||
.S0_AXI_ARESETN (~dram_rst ),
|
||||
.S0_AXI_araddr (dram_axi_araddr [ 32*0 +: 32]),
|
||||
.S0_AXI_arburst (dram_axi_arburst [ 2*0 +: 2]),
|
||||
.S0_AXI_arcache (dram_axi_arcache [ 4*0 +: 4]),
|
||||
.S0_AXI_arid (dram_axi_arid [ 1*0 +: 1]),
|
||||
.S0_AXI_arlen (dram_axi_arlen [ 8*0 +: 8]),
|
||||
.S0_AXI_arlock (dram_axi_arlock [ 1*0 +: 1]),
|
||||
.S0_AXI_arprot (dram_axi_arprot [ 3*0 +: 3]),
|
||||
.S0_AXI_arqos (dram_axi_arqos [ 4*0 +: 4]),
|
||||
.S0_AXI_arready (dram_axi_arready [ 1*0 +: 1]),
|
||||
.S0_AXI_arregion(dram_axi_arregion[ 4*0 +: 4]),
|
||||
.S0_AXI_arsize (dram_axi_arsize [ 3*0 +: 3]),
|
||||
.S0_AXI_arvalid (dram_axi_arvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_awaddr (dram_axi_awaddr [ 32*0 +: 32]),
|
||||
.S0_AXI_awburst (dram_axi_awburst [ 2*0 +: 2]),
|
||||
.S0_AXI_awcache (dram_axi_awcache [ 4*0 +: 4]),
|
||||
.S0_AXI_awid (dram_axi_awid [ 1*0 +: 1]),
|
||||
.S0_AXI_awlen (dram_axi_awlen [ 8*0 +: 8]),
|
||||
.S0_AXI_awlock (dram_axi_awlock [ 1*0 +: 1]),
|
||||
.S0_AXI_awprot (dram_axi_awprot [ 3*0 +: 3]),
|
||||
.S0_AXI_awqos (dram_axi_awqos [ 4*0 +: 4]),
|
||||
.S0_AXI_awready (dram_axi_awready [ 1*0 +: 1]),
|
||||
.S0_AXI_awregion(dram_axi_awregion[ 4*0 +: 4]),
|
||||
.S0_AXI_awsize (dram_axi_awsize [ 3*0 +: 3]),
|
||||
.S0_AXI_awvalid (dram_axi_awvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_bid (dram_axi_bid [ 1*0 +: 1]),
|
||||
.S0_AXI_bready (dram_axi_bready [ 1*0 +: 1]),
|
||||
.S0_AXI_bresp (dram_axi_bresp [ 2*0 +: 2]),
|
||||
.S0_AXI_bvalid (dram_axi_bvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_rid (dram_axi_rid [ 1*0 +: 1]),
|
||||
.S0_AXI_rlast (dram_axi_rlast [ 1*0 +: 1]),
|
||||
.S0_AXI_rready (dram_axi_rready [ 1*0 +: 1]),
|
||||
.S0_AXI_rresp (dram_axi_rresp [ 2*0 +: 2]),
|
||||
.S0_AXI_rvalid (dram_axi_rvalid [ 1*0 +: 1]),
|
||||
.S0_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*0 +: AXI_DWIDTH]),
|
||||
.S0_AXI_wlast (dram_axi_wlast [ 1*0 +: 1]),
|
||||
.S0_AXI_wready (dram_axi_wready [ 1*0 +: 1]),
|
||||
.S0_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*0 +: AXI_DWIDTH/8]),
|
||||
.S0_AXI_wvalid (dram_axi_wvalid [ 1*0 +: 1]),
|
||||
.S1_AXI_araddr (dram_axi_araddr [ 32*1 +: 32]),
|
||||
.S1_AXI_arburst (dram_axi_arburst [ 2*1 +: 2]),
|
||||
.S1_AXI_arcache (dram_axi_arcache [ 4*1 +: 4]),
|
||||
.S1_AXI_arid (dram_axi_arid [ 1*1 +: 1]),
|
||||
.S1_AXI_arlen (dram_axi_arlen [ 8*1 +: 8]),
|
||||
.S1_AXI_arlock (dram_axi_arlock [ 1*1 +: 1]),
|
||||
.S1_AXI_arprot (dram_axi_arprot [ 3*1 +: 3]),
|
||||
.S1_AXI_arqos (dram_axi_arqos [ 4*1 +: 4]),
|
||||
.S1_AXI_arready (dram_axi_arready [ 1*1 +: 1]),
|
||||
.S1_AXI_arregion(dram_axi_arregion[ 4*1 +: 4]),
|
||||
.S1_AXI_arsize (dram_axi_arsize [ 3*1 +: 3]),
|
||||
.S1_AXI_arvalid (dram_axi_arvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_awaddr (dram_axi_awaddr [ 32*1 +: 32]),
|
||||
.S1_AXI_awburst (dram_axi_awburst [ 2*1 +: 2]),
|
||||
.S1_AXI_awcache (dram_axi_awcache [ 4*1 +: 4]),
|
||||
.S1_AXI_awid (dram_axi_awid [ 1*1 +: 1]),
|
||||
.S1_AXI_awlen (dram_axi_awlen [ 8*1 +: 8]),
|
||||
.S1_AXI_awlock (dram_axi_awlock [ 1*1 +: 1]),
|
||||
.S1_AXI_awprot (dram_axi_awprot [ 3*1 +: 3]),
|
||||
.S1_AXI_awqos (dram_axi_awqos [ 4*1 +: 4]),
|
||||
.S1_AXI_awready (dram_axi_awready [ 1*1 +: 1]),
|
||||
.S1_AXI_awregion(dram_axi_awregion[ 4*1 +: 4]),
|
||||
.S1_AXI_awsize (dram_axi_awsize [ 3*1 +: 3]),
|
||||
.S1_AXI_awvalid (dram_axi_awvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_bid (dram_axi_bid [ 1*1 +: 1]),
|
||||
.S1_AXI_bready (dram_axi_bready [ 1*1 +: 1]),
|
||||
.S1_AXI_bresp (dram_axi_bresp [ 2*1 +: 2]),
|
||||
.S1_AXI_bvalid (dram_axi_bvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_rdata (dram_axi_rdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_rid (dram_axi_rid [ 1*1 +: 1]),
|
||||
.S1_AXI_rlast (dram_axi_rlast [ 1*1 +: 1]),
|
||||
.S1_AXI_rready (dram_axi_rready [ 1*1 +: 1]),
|
||||
.S1_AXI_rresp (dram_axi_rresp [ 2*1 +: 2]),
|
||||
.S1_AXI_rvalid (dram_axi_rvalid [ 1*1 +: 1]),
|
||||
.S1_AXI_wdata (dram_axi_wdata [ AXI_DWIDTH*1 +: AXI_DWIDTH]),
|
||||
.S1_AXI_wlast (dram_axi_wlast [ 1*1 +: 1]),
|
||||
.S1_AXI_wready (dram_axi_wready [ 1*1 +: 1]),
|
||||
.S1_AXI_wstrb (dram_axi_wstrb [AXI_DWIDTH/8*1 +: AXI_DWIDTH/8]),
|
||||
.S1_AXI_wvalid (dram_axi_wvalid [ 1*1 +: 1])
|
||||
);
|
||||
end
|
||||
end
|
||||
|
||||
ddr4_64bits ddr4_64bits_i (
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